mirror of https://github.com/acidanthera/audk.git
OvmfPkg/PciHostBridgeLib: Scan for root bridges when running over Xen
Contributed-under: TianoCore Contribution Agreement 1.0 Signed-off-by: Ruiyu Ni <ruiyu.ni@intel.com> Acked-by: Laszlo Ersek <lersek@redhat.com> Tested-by: Gary Lin <glin@suse.com>
This commit is contained in:
Ruiyu Ni
parent
c0a2591b30
commit
49effaf26e
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@ -0,0 +1,75 @@
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/** @file
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Header file of OVMF instance of PciHostBridgeLib.
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Copyright (c) 2016, Intel Corporation. All rights reserved.<BR>
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This program and the accompanying materials are licensed and made available
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under the terms and conditions of the BSD License which accompanies this
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distribution. The full text of the license may be found at
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http://opensource.org/licenses/bsd-license.php.
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THE PROGRAM IS DISTRIBUTED UNDER THE BSD LICENSE ON AN "AS IS" BASIS, WITHOUT
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WARRANTIES OR REPRESENTATIONS OF ANY KIND, EITHER EXPRESS OR IMPLIED.
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**/
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PCI_ROOT_BRIDGE *
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ScanForRootBridges (
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UINTN *NumberOfRootBridges
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);
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/**
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Initialize a PCI_ROOT_BRIDGE structure.
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@param[in] Supports Supported attributes.
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@param[in] Attributes Initial attributes.
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@param[in] AllocAttributes Allocation attributes.
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@param[in] RootBusNumber The bus number to store in RootBus.
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@param[in] MaxSubBusNumber The inclusive maximum bus number that can be
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assigned to any subordinate bus found behind any
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PCI bridge hanging off this root bus.
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The caller is repsonsible for ensuring that
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RootBusNumber <= MaxSubBusNumber. If
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RootBusNumber equals MaxSubBusNumber, then the
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root bus has no room for subordinate buses.
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@param[in] Io IO aperture.
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@param[in] Mem MMIO aperture.
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@param[in] MemAbove4G MMIO aperture above 4G.
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@param[in] PMem Prefetchable MMIO aperture.
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@param[in] PMemAbove4G Prefetchable MMIO aperture above 4G.
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@param[out] RootBus The PCI_ROOT_BRIDGE structure (allocated by the
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caller) that should be filled in by this
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function.
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@retval EFI_SUCCESS Initialization successful. A device path
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consisting of an ACPI device path node, with
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UID = RootBusNumber, has been allocated and
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linked into RootBus.
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@retval EFI_OUT_OF_RESOURCES Memory allocation failed.
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**/
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EFI_STATUS
|
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|
InitRootBridge (
|
||||||
|
IN UINT64 Supports,
|
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|
IN UINT64 Attributes,
|
||||||
|
IN UINT64 AllocAttributes,
|
||||||
|
IN UINT8 RootBusNumber,
|
||||||
|
IN UINT8 MaxSubBusNumber,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *Io,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *Mem,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *MemAbove4G,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *PMem,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *PMemAbove4G,
|
||||||
|
OUT PCI_ROOT_BRIDGE *RootBus
|
||||||
|
);
|
||||||
|
|
@ -28,6 +28,7 @@
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||||||
#include <Library/PciHostBridgeLib.h>
|
#include <Library/PciHostBridgeLib.h>
|
||||||
#include <Library/PciLib.h>
|
#include <Library/PciLib.h>
|
||||||
#include <Library/QemuFwCfgLib.h>
|
#include <Library/QemuFwCfgLib.h>
|
||||||
|
#include "PciHostBridge.h"
|
||||||
|
|
||||||
|
|
||||||
#pragma pack(1)
|
#pragma pack(1)
|
||||||
|
|
@ -113,7 +114,6 @@ STATIC PCI_ROOT_BRIDGE_APERTURE mNonExistAperture = { MAX_UINT64, 0 };
|
||||||
|
|
||||||
@retval EFI_OUT_OF_RESOURCES Memory allocation failed.
|
@retval EFI_OUT_OF_RESOURCES Memory allocation failed.
|
||||||
**/
|
**/
|
||||||
STATIC
|
|
||||||
EFI_STATUS
|
EFI_STATUS
|
||||||
InitRootBridge (
|
InitRootBridge (
|
||||||
IN UINT64 Supports,
|
IN UINT64 Supports,
|
||||||
|
|
@ -217,6 +217,10 @@ PciHostBridgeGetRootBridges (
|
||||||
PCI_ROOT_BRIDGE_APERTURE Mem;
|
PCI_ROOT_BRIDGE_APERTURE Mem;
|
||||||
PCI_ROOT_BRIDGE_APERTURE MemAbove4G;
|
PCI_ROOT_BRIDGE_APERTURE MemAbove4G;
|
||||||
|
|
||||||
|
if (PcdGetBool (PcdPciDisableBusEnumeration)) {
|
||||||
|
return ScanForRootBridges (Count);
|
||||||
|
}
|
||||||
|
|
||||||
Attributes = EFI_PCI_ATTRIBUTE_IDE_PRIMARY_IO |
|
Attributes = EFI_PCI_ATTRIBUTE_IDE_PRIMARY_IO |
|
||||||
EFI_PCI_ATTRIBUTE_IDE_SECONDARY_IO |
|
EFI_PCI_ATTRIBUTE_IDE_SECONDARY_IO |
|
||||||
EFI_PCI_ATTRIBUTE_ISA_IO_16 |
|
EFI_PCI_ATTRIBUTE_ISA_IO_16 |
|
||||||
|
|
|
||||||
|
|
@ -32,6 +32,8 @@
|
||||||
|
|
||||||
[Sources]
|
[Sources]
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||||||
PciHostBridgeLib.c
|
PciHostBridgeLib.c
|
||||||
|
XenSupport.c
|
||||||
|
PciHostBridge.h
|
||||||
|
|
||||||
[Packages]
|
[Packages]
|
||||||
MdeModulePkg/MdeModulePkg.dec
|
MdeModulePkg/MdeModulePkg.dec
|
||||||
|
|
@ -54,3 +56,4 @@
|
||||||
gUefiOvmfPkgTokenSpaceGuid.PcdPciMmio64Base
|
gUefiOvmfPkgTokenSpaceGuid.PcdPciMmio64Base
|
||||||
gUefiOvmfPkgTokenSpaceGuid.PcdPciMmio64Size
|
gUefiOvmfPkgTokenSpaceGuid.PcdPciMmio64Size
|
||||||
gUefiOvmfPkgTokenSpaceGuid.PcdOvmfHostBridgePciDevId
|
gUefiOvmfPkgTokenSpaceGuid.PcdOvmfHostBridgePciDevId
|
||||||
|
gEfiMdeModulePkgTokenSpaceGuid.PcdPciDisableBusEnumeration
|
||||||
|
|
|
||||||
|
|
@ -0,0 +1,456 @@
|
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/** @file
|
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|
Scan the entire PCI bus for root bridges to support OVMF above Xen.
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Copyright (c) 2016, Intel Corporation. All rights reserved.<BR>
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This program and the accompanying materials are licensed and made available
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under the terms and conditions of the BSD License which accompanies this
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http://opensource.org/licenses/bsd-license.php.
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THE PROGRAM IS DISTRIBUTED UNDER THE BSD LICENSE ON AN "AS IS" BASIS, WITHOUT
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WARRANTIES OR REPRESENTATIONS OF ANY KIND, EITHER EXPRESS OR IMPLIED.
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**/
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|
#include <PiDxe.h>
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||||||
|
|
||||||
|
#include <IndustryStandard/Pci.h>
|
||||||
|
#include <IndustryStandard/Q35MchIch9.h>
|
||||||
|
|
||||||
|
#include <Protocol/PciHostBridgeResourceAllocation.h>
|
||||||
|
#include <Protocol/PciRootBridgeIo.h>
|
||||||
|
|
||||||
|
#include <Library/BaseMemoryLib.h>
|
||||||
|
#include <Library/DebugLib.h>
|
||||||
|
#include <Library/MemoryAllocationLib.h>
|
||||||
|
#include <Library/PciHostBridgeLib.h>
|
||||||
|
#include <Library/PciLib.h>
|
||||||
|
#include "PciHostBridge.h"
|
||||||
|
|
||||||
|
STATIC
|
||||||
|
VOID
|
||||||
|
PcatPciRootBridgeBarExisted (
|
||||||
|
IN UINT64 Address,
|
||||||
|
OUT UINT32 *OriginalValue,
|
||||||
|
OUT UINT32 *Value
|
||||||
|
)
|
||||||
|
{
|
||||||
|
//
|
||||||
|
// Preserve the original value
|
||||||
|
//
|
||||||
|
*OriginalValue = PciRead32 (Address);
|
||||||
|
|
||||||
|
//
|
||||||
|
// Disable timer interrupt while the BAR is probed
|
||||||
|
//
|
||||||
|
DisableInterrupts ();
|
||||||
|
|
||||||
|
PciWrite32 (Address, 0xFFFFFFFF);
|
||||||
|
*Value = PciRead32 (Address);
|
||||||
|
PciWrite32 (Address, *OriginalValue);
|
||||||
|
|
||||||
|
//
|
||||||
|
// Enable interrupt
|
||||||
|
//
|
||||||
|
EnableInterrupts ();
|
||||||
|
}
|
||||||
|
|
||||||
|
STATIC
|
||||||
|
VOID
|
||||||
|
PcatPciRootBridgeParseBars (
|
||||||
|
IN UINT16 Command,
|
||||||
|
IN UINTN Bus,
|
||||||
|
IN UINTN Device,
|
||||||
|
IN UINTN Function,
|
||||||
|
IN UINTN BarOffsetBase,
|
||||||
|
IN UINTN BarOffsetEnd,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *Io,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *Mem,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *MemAbove4G,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *PMem,
|
||||||
|
IN PCI_ROOT_BRIDGE_APERTURE *PMemAbove4G
|
||||||
|
|
||||||
|
)
|
||||||
|
{
|
||||||
|
UINT32 OriginalValue;
|
||||||
|
UINT32 Value;
|
||||||
|
UINT32 OriginalUpperValue;
|
||||||
|
UINT32 UpperValue;
|
||||||
|
UINT64 Mask;
|
||||||
|
UINTN Offset;
|
||||||
|
UINT64 Base;
|
||||||
|
UINT64 Length;
|
||||||
|
UINT64 Limit;
|
||||||
|
PCI_ROOT_BRIDGE_APERTURE *MemAperture;
|
||||||
|
|
||||||
|
for (Offset = BarOffsetBase; Offset < BarOffsetEnd; Offset += sizeof (UINT32)) {
|
||||||
|
PcatPciRootBridgeBarExisted (
|
||||||
|
PCI_LIB_ADDRESS (Bus, Device, Function, Offset),
|
||||||
|
&OriginalValue, &Value
|
||||||
|
);
|
||||||
|
if (Value == 0) {
|
||||||
|
continue;
|
||||||
|
}
|
||||||
|
if ((Value & BIT0) == BIT0) {
|
||||||
|
//
|
||||||
|
// IO Bar
|
||||||
|
//
|
||||||
|
if (Command & EFI_PCI_COMMAND_IO_SPACE) {
|
||||||
|
Mask = 0xfffffffc;
|
||||||
|
Base = OriginalValue & Mask;
|
||||||
|
Length = ((~(Value & Mask)) & Mask) + 0x04;
|
||||||
|
if (!(Value & 0xFFFF0000)) {
|
||||||
|
Length &= 0x0000FFFF;
|
||||||
|
}
|
||||||
|
Limit = Base + Length - 1;
|
||||||
|
|
||||||
|
if (Base < Limit) {
|
||||||
|
if (Io->Base > Base) {
|
||||||
|
Io->Base = Base;
|
||||||
|
}
|
||||||
|
if (Io->Limit < Limit) {
|
||||||
|
Io->Limit = Limit;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
}
|
||||||
|
} else {
|
||||||
|
//
|
||||||
|
// Mem Bar
|
||||||
|
//
|
||||||
|
if (Command & EFI_PCI_COMMAND_MEMORY_SPACE) {
|
||||||
|
|
||||||
|
Mask = 0xfffffff0;
|
||||||
|
Base = OriginalValue & Mask;
|
||||||
|
Length = Value & Mask;
|
||||||
|
|
||||||
|
if ((Value & (BIT1 | BIT2)) == 0) {
|
||||||
|
//
|
||||||
|
// 32bit
|
||||||
|
//
|
||||||
|
Length = ((~Length) + 1) & 0xffffffff;
|
||||||
|
|
||||||
|
if ((Value & BIT3) == BIT3) {
|
||||||
|
MemAperture = PMem;
|
||||||
|
} else {
|
||||||
|
MemAperture = Mem;
|
||||||
|
}
|
||||||
|
} else {
|
||||||
|
//
|
||||||
|
// 64bit
|
||||||
|
//
|
||||||
|
Offset += 4;
|
||||||
|
PcatPciRootBridgeBarExisted (
|
||||||
|
PCI_LIB_ADDRESS (Bus, Device, Function, Offset),
|
||||||
|
&OriginalUpperValue,
|
||||||
|
&UpperValue
|
||||||
|
);
|
||||||
|
|
||||||
|
Base = Base | LShiftU64 ((UINT64) OriginalUpperValue, 32);
|
||||||
|
Length = Length | LShiftU64 ((UINT64) UpperValue, 32);
|
||||||
|
Length = (~Length) + 1;
|
||||||
|
|
||||||
|
if ((Value & BIT3) == BIT3) {
|
||||||
|
MemAperture = PMemAbove4G;
|
||||||
|
} else {
|
||||||
|
MemAperture = MemAbove4G;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
Limit = Base + Length - 1;
|
||||||
|
if (Base < Limit) {
|
||||||
|
if (MemAperture->Base > Base) {
|
||||||
|
MemAperture->Base = Base;
|
||||||
|
}
|
||||||
|
if (MemAperture->Limit < Limit) {
|
||||||
|
MemAperture->Limit = Limit;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
}
|
||||||
|
}
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
PCI_ROOT_BRIDGE *
|
||||||
|
ScanForRootBridges (
|
||||||
|
UINTN *NumberOfRootBridges
|
||||||
|
)
|
||||||
|
{
|
||||||
|
UINTN PrimaryBus;
|
||||||
|
UINTN SubBus;
|
||||||
|
UINT8 Device;
|
||||||
|
UINT8 Function;
|
||||||
|
UINTN NumberOfDevices;
|
||||||
|
UINT64 Address;
|
||||||
|
PCI_TYPE01 Pci;
|
||||||
|
UINT64 Attributes;
|
||||||
|
UINT64 Base;
|
||||||
|
UINT64 Limit;
|
||||||
|
UINT64 Value;
|
||||||
|
PCI_ROOT_BRIDGE_APERTURE Io, Mem, MemAbove4G, PMem, PMemAbove4G, *MemAperture;
|
||||||
|
PCI_ROOT_BRIDGE *RootBridges;
|
||||||
|
UINTN BarOffsetEnd;
|
||||||
|
|
||||||
|
|
||||||
|
*NumberOfRootBridges = 0;
|
||||||
|
RootBridges = NULL;
|
||||||
|
|
||||||
|
//
|
||||||
|
// After scanning all the PCI devices on the PCI root bridge's primary bus,
|
||||||
|
// update the Primary Bus Number for the next PCI root bridge to be this PCI
|
||||||
|
// root bridge's subordinate bus number + 1.
|
||||||
|
//
|
||||||
|
for (PrimaryBus = 0; PrimaryBus <= PCI_MAX_BUS; PrimaryBus = SubBus + 1) {
|
||||||
|
SubBus = PrimaryBus;
|
||||||
|
Attributes = 0;
|
||||||
|
Io.Base = Mem.Base = MemAbove4G.Base = PMem.Base = PMemAbove4G.Base = MAX_UINT64;
|
||||||
|
Io.Limit = Mem.Limit = MemAbove4G.Limit = PMem.Limit = PMemAbove4G.Limit = 0;
|
||||||
|
//
|
||||||
|
// Scan all the PCI devices on the primary bus of the PCI root bridge
|
||||||
|
//
|
||||||
|
for (Device = 0, NumberOfDevices = 0; Device <= PCI_MAX_DEVICE; Device++) {
|
||||||
|
|
||||||
|
for (Function = 0; Function <= PCI_MAX_FUNC; Function++) {
|
||||||
|
|
||||||
|
//
|
||||||
|
// Compute the PCI configuration address of the PCI device to probe
|
||||||
|
//
|
||||||
|
Address = PCI_LIB_ADDRESS (PrimaryBus, Device, Function, 0);
|
||||||
|
|
||||||
|
//
|
||||||
|
// Read the Vendor ID from the PCI Configuration Header
|
||||||
|
//
|
||||||
|
if (PciRead16 (Address) == MAX_UINT16) {
|
||||||
|
if (Function == 0) {
|
||||||
|
//
|
||||||
|
// If the PCI Configuration Read fails, or a PCI device does not
|
||||||
|
// exist, then skip this entire PCI device
|
||||||
|
//
|
||||||
|
break;
|
||||||
|
} else {
|
||||||
|
//
|
||||||
|
// If PCI function != 0, VendorId == 0xFFFF, we continue to search
|
||||||
|
// PCI function.
|
||||||
|
//
|
||||||
|
continue;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
//
|
||||||
|
// Read the entire PCI Configuration Header
|
||||||
|
//
|
||||||
|
PciReadBuffer (Address, sizeof (Pci), &Pci);
|
||||||
|
|
||||||
|
//
|
||||||
|
// Increment the number of PCI device found on the primary bus of the
|
||||||
|
// PCI root bridge
|
||||||
|
//
|
||||||
|
NumberOfDevices++;
|
||||||
|
|
||||||
|
//
|
||||||
|
// Look for devices with the VGA Palette Snoop enabled in the COMMAND
|
||||||
|
// register of the PCI Config Header
|
||||||
|
//
|
||||||
|
if ((Pci.Hdr.Command & EFI_PCI_COMMAND_VGA_PALETTE_SNOOP) != 0) {
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_PALETTE_IO;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_PALETTE_IO_16;
|
||||||
|
}
|
||||||
|
|
||||||
|
BarOffsetEnd = 0;
|
||||||
|
|
||||||
|
//
|
||||||
|
// PCI-PCI Bridge
|
||||||
|
//
|
||||||
|
if (IS_PCI_BRIDGE (&Pci)) {
|
||||||
|
//
|
||||||
|
// Get the Bus range that the PPB is decoding
|
||||||
|
//
|
||||||
|
if (Pci.Bridge.SubordinateBus > SubBus) {
|
||||||
|
//
|
||||||
|
// If the suborinate bus number of the PCI-PCI bridge is greater
|
||||||
|
// than the PCI root bridge's current subordinate bus number,
|
||||||
|
// then update the PCI root bridge's subordinate bus number
|
||||||
|
//
|
||||||
|
SubBus = Pci.Bridge.SubordinateBus;
|
||||||
|
}
|
||||||
|
|
||||||
|
//
|
||||||
|
// Get the I/O range that the PPB is decoding
|
||||||
|
//
|
||||||
|
Value = Pci.Bridge.IoBase & 0x0f;
|
||||||
|
Base = ((UINT32) Pci.Bridge.IoBase & 0xf0) << 8;
|
||||||
|
Limit = (((UINT32) Pci.Bridge.IoLimit & 0xf0) << 8) | 0x0fff;
|
||||||
|
if (Value == BIT0) {
|
||||||
|
Base |= ((UINT32) Pci.Bridge.IoBaseUpper16 << 16);
|
||||||
|
Limit |= ((UINT32) Pci.Bridge.IoLimitUpper16 << 16);
|
||||||
|
}
|
||||||
|
if (Base < Limit) {
|
||||||
|
if (Io.Base > Base) {
|
||||||
|
Io.Base = Base;
|
||||||
|
}
|
||||||
|
if (Io.Limit < Limit) {
|
||||||
|
Io.Limit = Limit;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
//
|
||||||
|
// Get the Memory range that the PPB is decoding
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//
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Base = ((UINT32) Pci.Bridge.MemoryBase & 0xfff0) << 16;
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Limit = (((UINT32) Pci.Bridge.MemoryLimit & 0xfff0) << 16) | 0xfffff;
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if (Base < Limit) {
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||||||
|
if (Mem.Base > Base) {
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||||||
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Mem.Base = Base;
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}
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||||||
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if (Mem.Limit < Limit) {
|
||||||
|
Mem.Limit = Limit;
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|
}
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|
}
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//
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// Get the Prefetchable Memory range that the PPB is decoding
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//
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Value = Pci.Bridge.PrefetchableMemoryBase & 0x0f;
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Base = ((UINT32) Pci.Bridge.PrefetchableMemoryBase & 0xfff0) << 16;
|
||||||
|
Limit = (((UINT32) Pci.Bridge.PrefetchableMemoryLimit & 0xfff0)
|
||||||
|
<< 16) | 0xfffff;
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||||||
|
MemAperture = &PMem;
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if (Value == BIT0) {
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Base |= LShiftU64 (Pci.Bridge.PrefetchableBaseUpper32, 32);
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||||||
|
Limit |= LShiftU64 (Pci.Bridge.PrefetchableLimitUpper32, 32);
|
||||||
|
MemAperture = &PMemAbove4G;
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||||||
|
}
|
||||||
|
if (Base < Limit) {
|
||||||
|
if (MemAperture->Base > Base) {
|
||||||
|
MemAperture->Base = Base;
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||||||
|
}
|
||||||
|
if (MemAperture->Limit < Limit) {
|
||||||
|
MemAperture->Limit = Limit;
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|
}
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|
}
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//
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// Look at the PPB Configuration for legacy decoding attributes
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//
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if ((Pci.Bridge.BridgeControl & EFI_PCI_BRIDGE_CONTROL_ISA)
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|
== EFI_PCI_BRIDGE_CONTROL_ISA) {
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||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_ISA_IO;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_ISA_IO_16;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_ISA_MOTHERBOARD_IO;
|
||||||
|
}
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||||||
|
if ((Pci.Bridge.BridgeControl & EFI_PCI_BRIDGE_CONTROL_VGA)
|
||||||
|
== EFI_PCI_BRIDGE_CONTROL_VGA) {
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_PALETTE_IO;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_MEMORY;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_IO;
|
||||||
|
if ((Pci.Bridge.BridgeControl & EFI_PCI_BRIDGE_CONTROL_VGA_16)
|
||||||
|
!= 0) {
|
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|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_PALETTE_IO_16;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_IO_16;
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|
}
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||||||
|
}
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|
BarOffsetEnd = OFFSET_OF (PCI_TYPE01, Bridge.Bar[2]);
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} else {
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//
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// Parse the BARs of the PCI device to get what I/O Ranges, Memory
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// Ranges, and Prefetchable Memory Ranges the device is decoding
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//
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if ((Pci.Hdr.HeaderType & HEADER_LAYOUT_CODE) == HEADER_TYPE_DEVICE) {
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BarOffsetEnd = OFFSET_OF (PCI_TYPE00, Device.Bar[6]);
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|
}
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|
}
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PcatPciRootBridgeParseBars (
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Pci.Hdr.Command,
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PrimaryBus,
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Device,
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Function,
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OFFSET_OF (PCI_TYPE00, Device.Bar),
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|
BarOffsetEnd,
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&Io,
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|
&Mem, &MemAbove4G,
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|
&PMem, &PMemAbove4G
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|
);
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//
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|
// See if the PCI device is an IDE controller
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//
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if (IS_CLASS2 (&Pci, PCI_CLASS_MASS_STORAGE,
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|
PCI_CLASS_MASS_STORAGE_IDE)) {
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|
if (Pci.Hdr.ClassCode[0] & 0x80) {
|
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|
Attributes |= EFI_PCI_ATTRIBUTE_IDE_PRIMARY_IO;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_IDE_SECONDARY_IO;
|
||||||
|
}
|
||||||
|
if (Pci.Hdr.ClassCode[0] & 0x01) {
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_IDE_PRIMARY_IO;
|
||||||
|
}
|
||||||
|
if (Pci.Hdr.ClassCode[0] & 0x04) {
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_IDE_SECONDARY_IO;
|
||||||
|
}
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|
}
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//
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|
// See if the PCI device is a legacy VGA controller or
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|
// a standard VGA controller
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//
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|
if (IS_CLASS2 (&Pci, PCI_CLASS_OLD, PCI_CLASS_OLD_VGA) ||
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|
IS_CLASS2 (&Pci, PCI_CLASS_DISPLAY, PCI_CLASS_DISPLAY_VGA)
|
||||||
|
) {
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_PALETTE_IO;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_PALETTE_IO_16;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_MEMORY;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_IO;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_VGA_IO_16;
|
||||||
|
}
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||||||
|
|
||||||
|
//
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||||||
|
// See if the PCI Device is a PCI - ISA or PCI - EISA
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|
// or ISA_POSITIVIE_DECODE Bridge device
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||||||
|
//
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||||||
|
if (Pci.Hdr.ClassCode[2] == PCI_CLASS_BRIDGE) {
|
||||||
|
if (Pci.Hdr.ClassCode[1] == PCI_CLASS_BRIDGE_ISA ||
|
||||||
|
Pci.Hdr.ClassCode[1] == PCI_CLASS_BRIDGE_EISA ||
|
||||||
|
Pci.Hdr.ClassCode[1] == PCI_CLASS_BRIDGE_ISA_PDECODE) {
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_ISA_IO;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_ISA_IO_16;
|
||||||
|
Attributes |= EFI_PCI_ATTRIBUTE_ISA_MOTHERBOARD_IO;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
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||||||
|
//
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|
// If this device is not a multi function device, then skip the rest
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|
// of this PCI device
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|
//
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|
if (Function == 0 && !IS_PCI_MULTI_FUNC (&Pci)) {
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|
break;
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|
}
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||||||
|
}
|
||||||
|
}
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|
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//
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// If at least one PCI device was found on the primary bus of this PCI
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|
// root bridge, then the PCI root bridge exists.
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|
//
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|
if (NumberOfDevices > 0) {
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|
RootBridges = ReallocatePool (
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||||||
|
(*NumberOfRootBridges) * sizeof (PCI_ROOT_BRIDGE),
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||||||
|
(*NumberOfRootBridges + 1) * sizeof (PCI_ROOT_BRIDGE),
|
||||||
|
RootBridges
|
||||||
|
);
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|
ASSERT (RootBridges != NULL);
|
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|
InitRootBridge (
|
||||||
|
Attributes, Attributes, 0,
|
||||||
|
(UINT8) PrimaryBus, (UINT8) SubBus,
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||||||
|
&Io, &Mem, &MemAbove4G, &PMem, &PMemAbove4G,
|
||||||
|
&RootBridges[*NumberOfRootBridges]
|
||||||
|
);
|
||||||
|
RootBridges[*NumberOfRootBridges].ResourceAssigned = TRUE;
|
||||||
|
//
|
||||||
|
// Increment the index for the next PCI Root Bridge
|
||||||
|
//
|
||||||
|
(*NumberOfRootBridges)++;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
return RootBridges;
|
||||||
|
}
|
||||||
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